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歐洲處理器計劃 (EPI) 已成功完成其第一個為期三年的階段，為超級計算機和汽車提供多核晶片設計。
該專案突出了 Rhea 通用處理器從 ARM 向 RISC-V 的轉變、RISC-V 加速器概念驗證和用於汽車應用的嵌入式高效能微控制器。
該專案有來自10個歐洲國家的28個合作伙伴，旨在使歐盟在高效能計算（HPC）晶片技術方面實現獨立。
第一階段 SGA1 的成功完成，為該專案的第二部分鋪平了道路，該專案將於 2022 年 1 月啟動。
通用處理器 (GPP) 的初始設計稱為 Rhea，在 Linley 會議上描述了 72 個 ARM Zeus 處理器。
法國超級計算機制造商 Atos 是通用處理器 (GPP) 流的主要合作伙伴，與 SiPearl 合作。他們定義了 Rhea 的架構規範，它現在有 29 個核心，使用 RISC-V 開放指令集架構，並且在模擬中處於 RTL 級別，而不是在矽中實現。該設計旨在用於 2023 年的超級計算機設計。
該專案表示：“憑藉 29 個 RISC-V 核心，SiPearl 用於設計 Rhea 的 Arm Neoverse V1 架構將為 HPC 應用程式提供有效、可擴充套件和可定製的解決方案。” “架構決策是遵循協同設計方法並透過分析高階智慧財產權 (IP) 塊的效能而做出的。
SiPearl 還優化了可擴充套件的片上網路 (NoC)，以實現核心、加速器、輸入/輸出 (IO) 和共享記憶體資源之間的高頻、高頻寬資料傳輸。”
“我們為利用歐洲大學和行業領導者獨家構建和部署的尖端技術和 IP 成功設計強大的 GPP 感到自豪。我們有信心，我們很快就會證明這個 GPP 在實現歐洲百億億級計算機器方面的重要作用，這是世界期待的 HPC 領域的下一個突破，”Atos 的 Stream 負責人 Emmanuel Ego 說。
“隨著 Rhea 處理器的釋出，我們都將為確保歐洲在 HPC 應用（例如個性化醫療、氣候建模和能源管理）方面的主權做出貢獻。” – SiPearl 的創始人兼執行長 Philippe Notton 說。
就 GPP 效能而言，記憶體控制器是最關鍵的 IP 之一。為了幫助評估架構選擇，CEA 開發了一個帶有特定儀器的完整模擬平臺，用於分析驅動高頻寬 HBM2E 儲存器的控制器效率。由於對所有記憶體命令和資料進行解碼和跟蹤，該平臺允許對記憶體裝置介面進行有效分析。HBM2E 子系統使用針對不同流量形狀的多個隨機和指令模式進行模擬，並涉及所有控制器功能以保持 HBM2E 效率。
該流還設計了許多最先進的嵌入式安全功能和關鍵技術。其中包括由 ProvenRun 開發的獨立安全管理系統 (SMS) 安全 IP，為 HPC 和邊緣處理器提供高階、通用標準認證的主權安全 IP。
比薩大學貢獻了一組加密 IP，稱為“Crypto Tile”，由 SiPearl 整合到 Rhea GPP 中。這為硬體安全模組提供了針對高階對稱（具有九種密碼模式的 AES）、非對稱（ECC、ECDSA、ECIES、ECDH）和雜湊 (SHA2/SHA3) 加密的完整安全服務，提供了幾個數量級的吞吐量增加並且與軟體解決方案相比降低了能源成本。
Crypto Tile 還包括安全金鑰儲存和安全 IP 配置、側通道攻擊保護、片上真隨機數生成 (TRNG)、Linux 核心驅動程式支援、最大安全級別的極端金鑰長度和高速 en(de)得益於面向 DMA 和 Arm 或 RISC-V 可程式設計核心的基於 AXI4 的介面，從而提高了加密吞吐量。由於Crystals Kyber 和 Dilithium 等 Lattice 演算法的實時實現，還提供了後量子加密支援。
歐洲處理器加速器 (EPAC) 測試晶片概念驗證使用開源指令集架構 (ISA) 確保不受專有許可和出口限制的影響，有助於擴充套件 RISC-V 生態系統並新增到 LLVM 編譯器資料庫。
EPAC 系統和 FPGA 軟體開發工具充分利用 Linux 作業系統，併為社群提供補丁、裝置驅動程式以及 OpenMP 和 MPI 等流行開源 HPC 軟體包的附加功能。此外，STX（模板/張量加速器）等硬體部分是使用圍繞 PULP 平臺獲得許可的開源方法開發的。
“EPI 中的加速器流有力地證明了 RISC-V 向量方法具有改變高效能計算領域的潛力，歐洲設計的架構能夠在低能耗預算下提供高效能，”Stream Leader Jesús Labarta 評論道（巴塞羅那超級計算中心）。“這項工作還體現了歐洲開放科學與合作的傳統。歐洲各地的合作伙伴聯手創造了任何單一組織都無法單獨實現的目標。透過與開源技術和專案合作，EPAC 流幫助擴充套件了 RISC-V 生態系統，使這項技術在未來越來越多的應用程式中可行。”
由 BSC 和 UNIZG 設計的 EPAC 向量處理單元 (VPU) 表明，使用 RISC-V 長向量架構進行高效能計算是一種可行的方法，在低能耗預算下提供高效能，並且可以將來擴大規模。
向量單元由 Semidynamics 的向量專用 Avispado RISC-V 核心和用於節能處理的 Gazzillion Misses 技術驅動。
由蘇黎世聯邦理工學院和弗勞恩霍夫設計的專用且靈活的基於 RISC-V 的眾核模板和張量加速器 (STX)，利用模板處理單元為機器學習和模板工作負載提供卓越的能效和可程式設計性。
同時，由 CEA 設計的可變精度加速器 (VRP) 提高了科學高效能計算應用（如多物理場模擬）的效率和可靠性。
EPAC 測試晶片還包括由 FORTH 和 CHALMERS 設計的多個分散式共享 L2 快取和一致性家庭節點 (L2HN)，針對向量處理單元的高頻寬要求進行了最佳化，同時提供了有助於多-核心可程式設計性。
所有處理單元和共享的 L2HN 組都透過高速 NoC 以模組化方式連線，允許系統擴充套件。該測試晶片還包括先進的 SERDES 技術，可實現超高頻寬的片外和跨晶片通訊。NoC 和 SERDES 均由 Extoll 設計。
用於測試 EPAC 測試晶片的 PCB（子板）是由 E4 Computer Engineering 設計和開發的。
在汽車微控制器領導者英飛凌的協調下，Automotive Stream 為可上路的自動駕駛汽車鋪平了道路，這要歸功於創新嵌入式高效能計算 (eHPC) 平臺和相關軟體開發套件 (SDK) 的概念驗證. 該平臺與小型化的、為汽車量身定製的通用處理器相結合，以具有成本效益、經濟可行和功能安全的方式滿足未來汽車對計算能力日益增長的需求。
“總的來說，這些成就證明了合作、協同作用和團隊精神，這些都是汽車行業研究工作的特點”，Stream Leader Knut Hufeld（英飛凌）說。“憑藉其專注於具有成本效益、安全和經過認證的汽車解決方案，它可以被視為歐洲處理器在 HPC 領域整體盈利的驅動帶。”
主要成就在一輛獲得道路批准的 BMW X5 汽車上展示，展示了開創性 eHPC 微控制器單元 (eHPC MCU) 的概念驗證，該單元整合在一個專門設計的靈活模組化計算平臺 (MCP) 中，以及多個 EPI 技術 IP。進行了大量試駕以收集資料並評估涉及自動駕駛引數的測試場景。
除其他功能外，該平臺還包括支援 AI 的整合攝像頭和 Elektrobit 雷達成像分析軟體，併為在系統中使用 EPI 加速器進行了整合準備。這是 Stream4 中 16 個合作伙伴密切合作的結果，旨在實現其指定合適的 eHPC 平臺、定義其架構和開發必要的軟體開發工具包 (SDK) 的目標。
英飛凌還在架構和效能方面擴充套件了汽車微控制器，使其可以作為主控器控制一個或多個加速器。相關方面是安全性、安全性、回退或減少應用程式的冗餘，就係統級的最高汽車安全完整性等級 D (ASIL D) 而言，這是自動駕駛應用程式所需的。
該平臺具有可擴充套件性和開放性，適用於未來汽車版本的 EPI 通用處理器、基於 EPAC RISC-V 的加速器以及用於 eHPC 的 Kalray 大規模並行處理器陣列 (MPPA) 加速器tile（作為 IP 開發）的插槽。
測試執行表明，EPI 現在擁有適用於至少 4 級自動駕駛的特定技術。
除了硬體平臺，該流還包括開發完整的軟體生態系統，在很大程度上基於汽車軟體專家 Elektrobit 的軟體產品。該領域還包括汽車 eHPC 平臺軟體堆疊，包括針對汽車 eHPC MCU 的經典汽車開放作業系統架構 (AUTOSAR) 開發，以及針對汽車應用至關重要的 HPC GPP 和 L4Re 管理程式（虛擬化）的自適應 AUTOSAR 開發。
為軟體鎖步共同建立了一個特定的概念，從而有助於整體 EPI 安全概念。
在這個三年的初始階段之後，結果和發現將在進一步的專案中繼續進行。
“我為 EPI 團隊在僅僅三年的合作後取得的傑出成果感到自豪，為歐洲的技術主權鋪平了道路。儘管由於可怕的 COVID-19 大流行造成了前所未有的工作條件，但我們以有限的預算按時實現了目標，這給我留下了特別深刻的印象。這為下一階段的啟動及其成功交付歐洲百億億級系統的前身 EUPEX（歐洲百億億級試點）和 TEP（歐洲試點）專案的歐洲處理器和加速器創造了有利條件，”EPI 董事會主席 Monchalin (Atos) Eric Monchalin (Atos)。
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